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2.部分仿真图预览
3.算法概述
基于FPGA的64QAM调制解调通信系统的设计和实现。首先，介绍了通信系统的基本原理和调制解调过程中需要用到的数学知识，包括正交幅度调制（QAM）和数字信号处理（DSP）算法。其次，详细介绍了64QAM调制解调系统的设计和实现步骤，包括信号生成、信号调制、信号解调和误码率测试等环节。最后，通过仿真实验和硬件实现测试，验证了系统的可行性和性能。
4.部分源码
......................................................................
wire serial_in;
wire data_flag;
integer mixed_out;
bit_signals bit_signals_U(
.clk (clk),
.rst (rst),
.enable (start),
.serial_in (serial_in),
.data_flag (data_flag)
);
s2p s2p_U(
.clk (clk),
.rst (rst),
.start (start),
.serial_in (serial_in),
.data_flag (data_flag),
.parallel_data (parallel_data)
);
// local_oscillator local_oscillator_u(
// .clk (clk),
// .rst (rst),
// .start (start),
// .sin (sin),
// .cos (cos)
// );
wire signed[9:0]mcos;
wire signed[9:0]msin;
NCO_Trans NCO_Trans_u(
.i_clk (clk),
.i_rst (~rst),
.i_K (10'd256),
.o_cos (mcos),
.o_sin (msin)
);
assign cos={mcos,6'd0};
assign sin={msin,6'd0};
mod64QAM mod64QAM_u(
.clk(clk),
.rst(rst),
.start(start),
.parallel_data(parallel_data),
.sin(sin),
.cos(cos),
.I_com(I_com),
.Q_com(Q_com)
);
//调制输出
always @(posedge clk or negedge rst)
begin
if(~rst)
begin
I_comcos<={16{1'b0}};
Q_comsin<={16{1'b0}};
end
else begin
I_comcos<=$signed(I_com[4:0])*$signed(cos[15:5]);
Q_comsin<=$signed(Q_com[4:0])*$signed(sin[15:5]);
end
end
endmodule
00_017m
