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m基于FPGA的交织解交织系统verilog实现,包含testbench

时间:2023/5/13 0:30:02 点击:

  核心提示:00_014m,包括程序操作录像...

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2.部分仿真图预览



3.算法概述

       交织解交织系统是一种数据传输技术,广泛应用于通信系统中,以提高数据传输的可靠性和抗干扰能力。该系统通过将数据在发送端进行交织处理,然后在接收端进行解交织处理,使数据的各个位分散到不同的位置上,从而降低信道噪声和干扰的影响,提高数据传输的可靠性。

4.部分源码

`timescale 1ns / 1ps

//

// Company: 

// Engineer: 

// 

// Create Date: 2023/05/12 19:58:30

// Design Name: 

// Module Name: tops

// Project Name: 

// Target Devices: 

// Tool Versions: 

// Description: 

// 

// Dependencies: 

// 

// Revision:

// Revision 0.01 - File Created

// Additional Comments:

// 

//

module tops(

input i_clk,

input i_rst,

input [2:0]i_sel,//配置2*2交织和4*4交织

input i_flager,

input i_enable,

input i_x,

 

output o_y_jz,

output o_enable_jz,

output o_start_jz, 

output o_y_djz,

output o_enable_djz,

output o_start_djz 

);

    

    

//交织   

jiaozhi jiaozhi_u(

.i_clk        (i_clk),

.i_rst        (i_rst),

.i_sel        (i_sel),//配置2*2交织和4*4交织

.i_flager     (i_flager),

.i_enable     (i_enable),

.i_x          (i_x),

.o_y          (o_y_jz),

.o_enable_jz  (o_enable_jz),

.o_start_jz   (o_start_jz) 

);

    

//解交织  

dejiaozhi dejiaozhi_u(

.i_clk        (i_clk),

.i_rst        (i_rst),

.i_sel        (i_sel),//配置2*2交织和4*4交织

.i_flager     (o_start_jz),

.i_enable     (o_enable_jz),

.i_x          (o_y_jz),

.o_y          (o_y_djz),

.o_enable_jz  (o_enable_djz),

.o_start_jz   (o_start_djz) 

); 

endmodule

00_014m

作者:我爱C编程 来源:我爱C编程
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